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[ 和図書 ] Verilog HDLで学ぶコンピュータアーキテクチャ

浅川 毅／共著 -- コロナ社 -- 2024.2 --

所蔵

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所蔵館 所蔵場所 資料区分 請求記号 資料コード 所蔵状態 資料の利用
配架日 協力貸出 利用状況 返却予定日 資料取扱 予約数 付録注記 備考
中央 書庫 一般洋図書 F/933.7/A13/B 7117076930 Digital BookShelf
2024/05/01 可能 利用可   0

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ISBN 2022030656
個人件名カナ Muslims,Ramadan,Siblings,Immigrants,Musulmans,Ramadan,Frères et sœurs,FICTION / Muslim.,FICTION / Coming of Age.,FICTION / Literary.,Muslims,Ramadan,Siblings,Muslims
多巻個人件名カナ Brooklyn (New York, N.Y.),Immigrants.,New York (State),New York (State),Brooklyn (New York, N.Y.)
資料情報1 『Verilog HDLで学ぶコンピュータアーキテクチャ』　浅川 毅／共著, 四柳 浩之／共著 , 土屋 秀和／共著　コロナ社　2024.2（所蔵館：中央　 請求記号：/548.2/5549/2024　 資料コード：7117622084）
URL https://catalog.library.metro.tokyo.lg.jp/winj/opac/switch-detail.do?lang=ja&bibid=1352062884

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目次 閉じる

第1章 コンピュータアーキテクチャ
  1.1 コンピュータの基本構成
  1.2 コンピュータの動作原理
  1.3 汎用コンピュータの動作の流れ
  演習問題
第2章 マイクロプロセッサとメインメモリ
  2.1 マイクロプロセッサ
  2.2 マイクロプロセッサの特性の尺度
  2.3 メモリ
  演習問題
第3章 コンピュータの表現と実装
  3.1 論理と電気的特性
  3.2 ステートマシンの表現
  3.3 コンピュータの実装法
  3.4 FPGAの概要
  演習問題
第4章 Verilog HDLによる回路設計
  4.1 ハードウェア記述言語を用いる設計の概要
  4.2 Verilog HDLによる論理設計
  4.3 Verilog HDLによるシミュレーション
  演習問題
第5章 レジスタ,カウンタ要素
  5.1 フリップフロップと順序回路
  5.2 レジスタ
  5.3 カウンタ
  5.4 レジスタのVerilog HDL記述例
  5.5 シフトレジスタのVerilog HDL記述例1
  5.6 シフトレジスタのVerilog HDL記述例2
  5.7 カウンタのVerilog HDL記述例1
  5.8 カウンタのVerilog HDL記述例2
  演習問題
第6章 演算要素
  6.1 演算装置
  6.2 演算装置のVerilog HDL記述例
  6.3 加算器のVerilog HDL記述例
  演習問題
第7章 制御要素
  7.1 デコーダとエンコーダ
  7.2 マルチプレクサとデマルチプレクサ
  7.3 制御回路の実装方式
  7.4 デコーダのVerilog HDL記述例
  7.5 エンコーダのVerilog HDL記述例
  7.6 マルチプレクサのVerilog HDL記述例
  7.7 デマルチプレクサのVerilog HDL記述例
  演習問題
第8章 コンピュータの命令
  8.1 命令と機械語
  8.2 命令サイクル
  8.3 命令の形式
  8.4 アドレスの指定
  8.5 代表的な命令
  演習問題
第9章 コンピュータの高速化技術と信頼性
  9.1 マルチプログラミング
  9.2 キャッシュメモリ
  9.3 マルチバンク
  9.4 パイプライン
  9.5 並列処理
  9.6 コンピュータシステムの信頼性
  演習問題
第10章 FPGAによるメモリのアクセス
  10.1 メモリの構成
  10.2 メモリコントローラの記述例
  10.3 メモリ機能チェックシステムの構築
  演習問題
第11章FPGAへの実装

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